Scrivere il testbench

module traffic_light (
  input clk,
  input reset,
  output reg red,
  output reg yellow,
  output reg green
);

  reg [1:0] state;
  reg [5:0] counter;

  // Assegnazioni delle uscite
  always @(*) begin
    case (state)
      0: begin green = 1; yellow = 0; red = 0; end
      1: begin green = 0; yellow = 1; red = 0; end
      2: begin green = 0; yellow = 0; red = 1; end
      default: begin green = 0; yellow = 0; red = 1; end
    endcase
  end

  // Macchina a stati con temporizzazione
  always @(posedge clk or posedge reset) begin
    if (reset) begin
      state <= 2;
      counter <= 0;
    end else begin
      if (counter == 0) begin
        case (state)
          0: begin
            state <= 1;
            counter <= 10;
          end
          1: begin
            state <= 2;
            counter <= 40;
          end
          2: begin
            state <= 0;
            counter <= 30;
          end
        endcase
      end else begin
        counter <= counter - 1;
      end
    end
  end

endmodule

module testbench;
  // TODO: Dichiara variabili reg per clk e reset
  
  // TODO: Dichiara variabili wire per red, yellow, green
  

  // TODO: Istanzia il modulo traffic_light con il nome uut
  // Collega clk, reset, red, yellow, green
  

  // TODO: Genera il clock (inverti il segnale ogni 1 unità di tempo)
  

  initial begin
    $display("Traffic Light Test");
    
    // TODO: Inizializza clk a 0
    
    // TODO: Applica reset (reset=1 per 2 unità di tempo, poi reset=0)
    
    
    // TODO: Esegui la simulazione per 100 unità di tempo
    
    
    $display("Test complete");
    $finish;
  end
endmodule