Wire-Typ

Teil des Abschnitts Grundlagen der Verilog-Journey von Coddy — Lektion 6 von 90.

In Verilog müssen wir deklarieren, welchen Signal-Typ wir verwenden. Der häufigste Typ ist wire.

Ein wire repräsentiert eine physische Verbindung zwischen Komponenten. Es ist wie ein echter Draht in einer Schaltung.

Wires können keine Werte speichern – sie leiten Werte nur weiter
Wires werden mit assign-Anweisungen verwendet
Wires werden verwendet, um Module miteinander zu verbinden

Deklarieren eines Wire

wire a;           // Einzelbit-Wire
wire b, c;        // Mehrere Wires in einer Zeile

Wie Wires funktionieren

module wire_example;
  wire x;
  reg y;
  
  assign x = y;  // x folgt immer y
endmodule

x ist mit y verbunden. Wann immer sich y ändert, ändert sich x sofort.

Wires werden häufig verwendet, um Eingänge und Ausgänge zu verbinden:

module and_gate(
  input a,      // 'a' ist standardmäßig ein wire
  input b,      // 'b' ist standardmäßig ein wire
  output c      // 'c' ist standardmäßig ein wire
);
  assign c = a & b;  // c wird durch diese Zuweisung getrieben
endmodule

In diesem Beispiel sind a, b und c alles Wires.

Wires sind der „Klebstoff“, der verschiedene Teile deines Schaltkreises miteinander verbindet!

Aufgabe

Was zu tun ist:

Füge einen Wire namens temp hinzu.

Probier es selbst

module simple(
  input a,
  input b,
  output c
);

  assign c = a & b; 
  
  // Deklariere wire temp hier 


endmodule

Teste dich selbst

Diese Lektion enthält ein kurzes Quiz. Starte die Lektion, um es zu beantworten und deinen Fortschritt zu speichern.

Alle Lektionen in Grundlagen

1Einführung

Was ist Verilog Hardware vs. Software Abstraktionsebenen im Design Dein erstes Modul Kommentare

4Operatoren Teil 1

Arithmetische Operatoren Modulo-Operator Vergleichsoperatoren Wiederholung – Einfache Mathematik Bitweise Operatoren

7Zuweisung und Gatter

Kontinuierliche Zuweisung Zuweisung mit Operatoren Integrierte Gatter-Primitive AND OR NOT Gatter XOR XNOR Gatter Zusammenfassung - Logikgatterschaltung

10Entscheidungsfindung

If-Anweisung If - Else Wiederholung - Einfacher Komparator Case-Anweisung Casex und Casez Wiederholung - ALU-Design

13Timing und Verzögerungen

Was sind Verzögerungen Gatter-Verzögerungen Zuweisungsverzögerungen Timescale-Direktive Takterzeugung Zusammenfassung – Timing-Steuerung

16Finale Herausforderungen

4-Bit-Zähler Decoder-Design Schieberegister