4-Bit-Zähler

Teil des Abschnitts Grundlagen der Verilog-Journey von Coddy — Lektion 84 von 90.

Aufgabe

Erstellen Sie einen 4-Bit-Zähler, der von 0 bis 15 zählt und dann wieder bei 0 beginnt.

Modulschnittstelle

Port	Richtung	Breite	Beschreibung
`clk`	input	1 Bit	Taktsignal
`reset`	input	1 Bit	Zähler auf 0 zurücksetzen
`count`	output	4 Bits	Aktueller Zählerwert

Wahrheitstabelle

Taktzyklus	count
Nach Reset	0
1	1
2	2
...	...
15	15
16	0 (Überlauf)

Ihre Aufgabe ist es, das untenstehende Modul zu vervollständigen.

Was zu tun ist:

Bei reset setzen Sie count auf 0
Erhöhen Sie bei jeder steigenden Taktflanke count um 1
Wenn count 15 erreicht, sollte die nächste Erhöhung auf 0 zurückspringen

Probier es selbst

module counter (
  input clk,
  input reset,
  output reg [3:0] count
);
  
  // TODO: Always-Block mit posedge clk und posedge reset hinzufügen
  // Bei Reset: count <= 0
  // Andernfalls: count <= count + 1

endmodule

Alle Lektionen in Grundlagen

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