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Verwendung des Case-Statements

Teil des Abschnitts Grundlagen der Verilog-Journey von Coddy — Lektion 66 von 90.

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Aufgabe

Bauen Sie einen 4-zu-1-Multiplexer unter Verwendung einer case-Anweisung anstelle von if-else.

Wahrheitstabelle

selout
00out = in0
01out = in1
10out = in2
11out = in3

Was zu tun ist:

  1. Erstellen Sie ein Module namens mux4to1_case
  2. Fügen Sie die Eingänge in0, in1, in2, in3 (jeweils 1 Bit) hinzu
  3. Fügen Sie den Eingang sel (2 Bits) hinzu
  4. Fügen Sie den Ausgang out (1 Bit, Type reg) hinzu
  5. Fügen Sie einen always @(*)-Block hinzu
  6. Fügen Sie darin eine case (sel)-Anweisung hinzu
  7. Fügen Sie Cases für 2'b00, 2'b01, 2'b10, 2'b11 hinzu
  8. Fügen Sie einen default-Case hinzu
  9. Schließen Sie mit endcase und endmodule ab

Probier es selbst

// TODO: Erstelle Modul namens mux4to1_case

// TODO: Füge Eingänge hinzu: in0, in1, in2, in3 (je 1 Bit)

// TODO: Füge Eingang sel hinzu (2 Bits)

// TODO: Füge Ausgang out hinzu (reg-Typ)

// TODO: Füge always @(*)-Block hinzu

// TODO: Füge case (sel) hinzu

// TODO: Füge case 2'b00: out = in0; hinzu

// TODO: Füge case 2'b01: out = in1; hinzu

// TODO: Füge case 2'b10: out = in2; hinzu

// TODO: Füge case 2'b11: out = in3; hinzu

// TODO: Füge default: out = in0; hinzu

// TODO: Füge endcase hinzu

// TODO: endmodule hinzufügen

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