Projeto de Mux 2 para 1

Parte da seção Fundamentos do Journey de Verilog da Coddy — lição 64 de 90.

Desafio

Um multiplexador (MUX) é um circuito digital que seleciona uma de várias entradas e a encaminha para uma única saída com base em um sinal de seleção. Pense nele como um seletor de dados — você tem várias entradas chegando e escolhe qual delas vai para a saída.

Neste projeto, você construirá multiplexadores de diferentes tamanhos usando instruções if-else e case.

Multiplexador 2 para 1

O multiplexador 2 para 1 é a forma mais simples. Ele possui duas entradas de dados (in0 e in1), uma entrada de seleção (sel) e uma saída (out). Quando sel é 0, a saída segue in0. Quando sel é 1, a saída segue in1. Você implementará isso usando uma instrução if-else dentro de um bloco always @(*).

Exemplo: Se in0 = 0, in1 = 1 e sel = 1, então out = 1.

Um multiplexador 2 para 1 seleciona uma de duas entradas e a passa para a saída com base em um sinal de seleção.

Tabela Verdade

sel	out
0	out = in0
1	out = in1

Quando sel é 0, a saída segue in0. Quando sel é 1, a saída segue in1.

O que fazer:

Crie um módulo nomeado mux2to1
Adicione a entrada in0 (1 bit)
Adicione a entrada in1 (1 bit)
Adicione a entrada sel (1 bit)
Adicione a saída out (1 bit, tipo reg)
Adicione um bloco always @(*)
Dentro, adicione uma instrução if-else:
- Se sel == 0, defina out = in0
- Caso contrário, defina out = in1
Feche com endmodule

Experimente você mesmo

// Passo 1: Crie o módulo chamado mux2to1


  // Passo 2: Adicione a entrada in0
  
  // Passo 3: Adicione a entrada in1
  
  // Passo 4: Adicione a entrada sel
  
  // Passo 5: Adicione a saída out (tipo reg)
  

  // Passo 6: Adicione o bloco always @(*)
  

    // Passo 7: Adicione a instrução if-else
    // Se sel == 0, out = in0
    // Senão, out = in1
    

// Passo 8: Endmodule

Projeto de Mux 2 para 1

Multiplexador 2 para 1

Tabela Verdade

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