Escribir el banco de pruebas
Parte de la sección Fundamentos del Journey de Verilog de Coddy. Lección 45 de 90.
Desafío
Ahora debemos comprobar si el semisumador funciona correctamente. Añade el código de prueba dentro del bloque initial.
Importante: Antes de añadir la prueba, debes cambiar los puertos del módulo para que la prueba funcione correctamente.
Qué hacer:
Paso 1: Cambiar las declaraciones de los puertos
- Cambia
input a, bporreg a, b(usa el punto y coma) - Cambia
output sum, carryporwire sum, carry(usa el punto y coma) - Elimina por completo los puertos del módulo (el módulo no debe tener
( ))
Paso 2: Añadir el código de prueba
- Añade un bloque
initial begin - Dentro del bloque, añade:
$display("a b | sum carry");
a = 0; b = 0; #1 $display("%d %d | %d %d", a, b, sum, carry);
a = 0; b = 1; #1 $display("%d %d | %d %d", a, b, sum, carry);
a = 1; b = 0; #1 $display("%d %d | %d %d", a, b, sum, carry);
a = 1; b = 1; #1 $display("%d %d | %d %d", a, b, sum, carry);
- Añade
$finish;para finalizar la prueba - Añade
endpara cerrar el bloque inicial
Pruébalo tú mismo
module half_adder (
input a,
input b,
output sum,
output carry
);
assign sum = a ^ b;
assign carry = a & b;
endmoduleTodas las lecciones de Fundamentos
1Introducción
Qué es VerilogHardware frente a softwareTu primer móduloComentariosNiveles de abstracción del diseño4Operadores, parte 1
Operadores aritméticosOperador móduloOperadores de comparaciónRepaso: matemáticas simplesOperadores bit a bit7Asignaciones y compuertas
Asignación continuaAsignación con operadoresPrimitivas de compuertas integradasCompuertas AND, OR y NOTCompuertas XOR y XNORRepaso: circuito de compuertas lógicas10Toma de decisiones
Sentencia IfIf - ElseRepaso - Comparador simpleSentencia CaseCasex y CasezRepaso - Diseño de ALU5Operadores, parte 2
Operadores lógicosOperadores de reducciónOperadores de desplazamientoOperador de concatenaciónOperador condicionalRepaso: desafío de operadores11Bucles
Bucle ForBucle WhileBucle de repeticiónBucle infinitoInstrucción DisableRepaso: patrones de bucles3Sistema numérico
Representación binariaNúmeros con tamañoNúmeros sin tamañoNúmeros negativosValores especiales X y ZRepaso: formatos numéricos6Módulos
Estructura de módulosPuertos de entrada y salidaPuertos inoutInstanciación de módulosAsignación de puertos por nombreAsignación de puertos por ordenRepaso: construir un móduloPractica por tu cuenta: Compilador de Verilog online